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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证讨论 › 请教，questasim 10.a能否仿真uvm1.1?

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[求助] 请教，questasim 10.a能否仿真uvm1.1?

发表于 2012-3-27 21:43:30 | 显示全部楼层 |阅读模式

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请教，questasim 10.a能否仿真uvm1.1?

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发表于 2012-3-30 17:03:00 | 显示全部楼层

可以.

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发表于 2012-4-1 15:00:31 | 显示全部楼层

可以仿uvm1.1 但是需要自行去编译uvm库
对于更低版本的uvm ，questasim10.0a应该已经编译好了，自己不用编译，直接导入uvm_pkg库就行
可以通过modelsim.ini搜搜看已经编译好的uvm库是什么版本

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发表于 2012-4-5 09:51:54 | 显示全部楼层

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发表于 2012-8-26 12:00:32 | 显示全部楼层

正在试验

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2012-9-11 19:55:05 | 显示全部楼层

同问正在试验

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发表于 2012-11-9 17:04:08 | 显示全部楼层

应该可以

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发表于 2013-8-17 14:54:15 | 显示全部楼层

学习，学习

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发表于 2013-9-8 22:34:28 | 显示全部楼层

学习，学习

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发表于 2013-9-18 13:05:45 | 显示全部楼层

必须可以的。questasim6.6d都已经可以了，只需要把安装目录下的questasim/verilog_src/uvm-1.1c下面的包编译一下就可以了。
下面可以根据自己安装的路径改一下，用makefile或者shell都可以
vlog -work xxx -sv +define+CVC -novopt +incdir+ ..../questasim_6.6f/questasim/verilog_src/uvm-1.1/src \
..../questasim_6.6f/questasim/verilog_src/uvm-1.1/src/uvm_pkg.sv
gcc -m64 -fPIC -DQUESTA -g -W -shared -I. -I..../questasim_10.1d/10.1d-p2/questasim/include ...../questasim_10.1d/10.1d-p2/questasim/verilog_src/uvm-1.1/src/dpi/uvm_dpi.cc -o uvm_dpi.so

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