DDR2 仿真 ready没有输出

easychen · 发表于 2012-3-19 14:19:46

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各位大侠~
请教一下。
我现在再做DDR2控制器的仿真，其IP是Quartus自动产生的，DDR2仿真模型是美光网站上下的。
为什么仿真的时候DDR2的ready信号一直没有输出呢？需要自己手动改哪里吗？
麻烦各位有经验的大侠，指教一下噢~

easychen · 发表于 2012-3-19 15:09:04

难过，为什么没人理我呢~
难道我描述得不清楚，恳请各位帮个忙哦~
在线等结果哦~

linzhjbtx · 发表于 2012-3-19 16:10:17

帮顶一下！

catcat_2 · 发表于 2012-3-19 16:12:01

本帖最后由 catcat_2 于 2012-3-20 08:57 编辑

楼主，麻烦移步：
http://www.alteraforum.com.cn/showtopic-1319-1.aspx

这个是我在隔壁发的帖子，里面是我仿真DDR2的过程。我也是外挂了美光的DDR2 MODEL做的仿真。

arsenal1215 · 发表于 2012-3-19 17:05:13

仔细看看altera生成的IP里面的testbench，可能会有答案

lucien_1986 · 发表于 2012-3-19 23:51:05

回复 1# easychen

你首先用quartus给出的testbench试试，看看ready信号能不能起来；然后对比一下你的testbench里面的波形与它有什么不同，大部分时候，出问题都是因为时钟或者复位造成的，你可以重点检查一下这两点。

easychen · 发表于 2012-3-20 10:36:57

回复 4# catcat_2

easychen · 发表于 2012-3-20 12:03:36

回复 5# arsenal1215

请教大侠，具体是怎样用呢？

easychen · 发表于 2012-3-20 12:04:37

回复 6# lucien_1986

quartus的testbench除了管脚定义，好像什么都没有噢。怎么看呢？

wangyingwei · 发表于 2012-3-21 13:40:01

你看下DDR是否完成了初始化及PHY的校验是否完成，只有上述操作完成了READY才会有效。你波形的最后一个信号local_init_done就是初始化完成的指示（没拉高）

[求助] DDR2 仿真 ready没有输出

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