DDR2 controller仿真问题

easychen · 发表于 2012-3-16 09:51:30

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我想请教一下。
在modelsim中，加入DDR2模型进行仿真。但是在DDR2 contoller那里就有问题，除了输入时钟，其他信号端都是高阻状态。为什么呢？至少锁相环输出时钟那是应该有输出的吧？哪里没设对呢？

jokeshe · 发表于 2012-3-21 01:17:20

如果是IP，要看是否初始化成功。

easychen · 发表于 2012-3-21 09:17:07

回复 2# jokeshe

貌似没有成功，报错说是所有bank需要进行预充电。我在想，既然是IP，不是预充电等命令都是内部完成，不用我们管吗？为什么会没有成功呢？

shiftc · 发表于 2012-5-6 00:23:27

想问下楼主这个问题是怎么解决的，我最近也遇到了这个仿真波形大多为高阻，只有clocksource有变化这个问题，请教下，谢谢！

ckzuan · 发表于 2012-5-7 08:28:14

楼主是用IP自带的tb跑的吧？我的都很正常！我是用VCS跑的，modelsim没试过。

jing_huan · 发表于 2012-5-7 11:12:40

GOOD!!

hexuezu · 发表于 2012-5-7 17:10:35

你仿真时间太短了吧

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