Clock Domain Crossing lab.

pkmanabc · 发表于 2012-2-23 23:22:06

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Lab1: SDC Checks (block level)
Lab2: Hierarchical SDC Checks (between block level and top level)
Lab3: Clock Domain Crossing Checks (RTL design)

CCD.zip (8.08 MB, 下载次数: 202 )

xlu · 发表于 2012-2-23 23:25:36

lab1 和lab2应该是constraint check，不是cdc check

yaoyaobluefox · 发表于 2012-11-21 09:58:13

学习一下先

baba_ship · 发表于 2012-11-22 23:33:16

thanks a lot dude, is it spyglass or zeroin

lionbupt1 · 发表于 2013-7-18 11:28:32

谢谢楼主分享，这个是用什么工具做的？

zxyglx · 发表于 2019-4-28 17:57:56

h9f3 · 发表于 2019-5-9 21:59:58

Thanks!

smaa · 发表于 2020-10-19 18:38:34

thanks for sharing

prabakaran_vlsi · 发表于 2020-10-20 02:19:12

thanks for sharing the files.

nekitoz · 发表于 2022-6-1 10:11:28

thanks

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