[已解决]关于edi使用的问题

estyzq · 发表于 2011-12-8 19:02:53

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本帖最后由 estyzq 于 2012-2-9 19:05 编辑

1.再使用encounter软件时，完成时钟树综合后，进行timing分析时，是不是需要将原来的sdc文件中对clk的uncertainty、transition、latency的设置去掉。如果需要，那么去掉后的sdc是否需要重新载入到edi软件中，以及如何载入到edi软件中？

estyzq · 发表于 2011-12-8 19:06:14

补充一下：在完成时钟树综合后的所有时序分析，以及最后一步的nanoRoute选项中提及的Time Driven，是否应该使用修改后的sdc文件？

陈涛 · 发表于 2011-12-9 09:13:59

以前讨论过，自己搜一下

mnluan · 发表于 2011-12-9 09:36:11

补充一下：在完成时钟树综合后的所有时序分析，以及最后一步的nanoRoute选项中提及的Time Driven，是否应该 ...
estyzq 发表于 2011-12-8 19:06

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是的。cts之前的sdc中有些余量是对CTS的估计值，做完CTS后，需要将这部分余量去掉。

estyzq · 发表于 2011-12-10 11:30:59

回复 4# mnluan

我感到困惑的是：在load design时使用的sdc，是需要进行第一次修改的，组要是改掉ideal和wireload，但是仍然保留了对时钟一些设置。
但是在进行cts的时候，需要重新载入一次sdc文件，这一次载入的sdc是需要修改吗？
以及在完成时钟树综合后，进行nanoroute时，是否需要修改sdc，并载入，已经如何载入这个修改的sdc？

icfbicfb · 发表于 2011-12-10 19:11:22

主要是搞清楚为啥cts后重新load new sdc，
1） clock现在是propagated 而不是ideal mode
2） clock uncertainty 现在只能是margin， skew已经得到
3） clock transition现在由propagated 得到，而不是人为设定，

因此new sdc 就去除了ideal clock , clock transition , 修改了clock uncertainty ，

你也可以在edi里面自己修改：
remove_clock_uncertainty
set_clock_uncertainty
set_propagated_clock
remove_clock_transition

至于route 后换sdc，这个没搞清楚，是调整clock margin吧，
这个都是很细微的东西

estyzq · 发表于 2011-12-11 15:05:27

回复 6# icfbicfb

版主威武，我明白了！！！

crafty1120 · 发表于 2013-12-13 10:45:03

威武霸气，帅得一笔！

oyo · 发表于 2014-9-2 16:48:56

好崇拜啊

renhonglei · 发表于 2014-9-2 23:28:01

厉害菜鸟飘过

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