请问下关于DDR-phy的问题

听香水榭 · 发表于 2021-4-13 10:29:48

谢谢楼主哈哈哈

uzljuljz · 发表于 2022-8-17 10:51:11

raino 发表于 2018-7-15 16:08
您好，我最近也在研究DDR PHY可否加个扣扣一起讨论，270150537.谢谢

我也想讨论

兔子IC · 发表于 2022-9-2 16:35:30

uzljuljz 发表于 2022-8-17 10:51
我也想讨论

建议，多看下ddr的文档，会理解更深入

欢迎加wx: pr-hao123,拉你进数字后端群

uzljuljz · 发表于 2022-9-4 03:29:00

兔子IC 发表于 2022-9-2 16:35
建议，多看下ddr的文档，会理解更深入

欢迎加wx: pr-hao123,拉你进数字后端群

好的，感谢大佬，前段时间正在看数据手册，发现的确很有帮助。

uzljuljz · 发表于 2023-7-7 13:46:14

uzljuljz 发表于 2022-8-17 10:51
我也想讨论

可以加Q讨论吗

曦玄 · 发表于 2024-5-10 10:15:47

icfbicfb 发表于 2011-11-16 23:08
应该是这样吧， PLL上面的干扰要越小越好，

DDR的timing比较麻烦， sdc 要仔细写，

版主，请帮忙推荐一下关于DDR phy的后端相关文档，先阶段我主要是看IP相关的文档，还有其他的比较好的论文推荐吗？
最近在写sdc

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