设计最优化的时钟电路

never_lazy · 发表于 2011-10-15 15:07:13

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设计最优化的时钟电路

serugudi · 发表于 2011-10-15 18:31:35

Dude
Thanks for sharing the docs

ghost_ic · 发表于 2011-10-15 20:17:21

研究研究！！

jycxkk · 发表于 2011-10-15 20:23:16

仔细看看

misrig001 · 发表于 2011-10-17 14:51:08

上当了
1.跟ASIC里面的时钟设计一点不相关，是画PCB时，设计板级电路的时钟结构
2.即便是讲板级电路的时钟结构，也只是点到而已
3.放在SOC板块里，实在有灌水赚积分的嫌疑，有点不厚道

lj_swust · 发表于 2011-10-17 23:39:14

正需要这个！！！

eleven61525157 · 发表于 2011-10-25 18:00:06

回复 1# never_lazy

GOOD DDDDDDDDDDD

eleven61525157 · 发表于 2011-10-25 18:02:32

回复 1# never_lazy

zkfnksfhakshgsda

xmf6227 · 发表于 2011-11-2 20:24:09

设计最优化的时钟电路

yuanchuang · 发表于 2011-11-12 10:59:55

研究研究！！

[资料] 设计最优化的时钟电路