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[求助] xilinx的工具ISE中有没有DDR2的IP内核呢

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发表于 2011-9-29 15:27:28 | 显示全部楼层 |阅读模式

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如题,xilinx的工具ISE中有没有DDR2的IP内核吗?是收费的吗?
我用的是v5系列的,可是我搜索DDR没有找到这个核
发表于 2011-9-29 19:35:25 | 显示全部楼层
回复 1# sarah.china


    mig就是啊
发表于 2011-9-29 19:48:23 | 显示全部楼层
回复 1# sarah.china


    coregen 里面的mig就是的,V5 是有DDR2的,没有DDR3
发表于 2011-9-29 22:28:45 | 显示全部楼层
有的,我用过的
发表于 2011-9-29 22:35:52 | 显示全部楼层
有点,不过ise版本应该是11.5以上
 楼主| 发表于 2011-10-3 10:09:44 | 显示全部楼层
回复 2# lanliang


    谢谢,已经找到了,但是是不是mig只支持VERILOG呢,为什么生成后的代码不是vhdl的呢,这个能改吗
 楼主| 发表于 2011-10-3 10:13:30 | 显示全部楼层
回复 3# solarwafer


    看到了,但是我在progect下边prefer language选的是vhdl,但是mig生成的还是verilog的例化,是不是MIG不支持VHDL呢
发表于 2011-10-11 00:37:29 | 显示全部楼层
我之前也用过MIG,记得应该是支持VHDL的,但我用的是Verilog.
 楼主| 发表于 2011-10-11 19:17:57 | 显示全部楼层
回复 8# VideoIC


    那你仿真的时候ddr2的模型是不是也是用的mig自动生成的呢?
发表于 2011-10-11 21:05:53 | 显示全部楼层
回复 9# sarah.china


    没用仿真模型,我后来在EDK中直接调用MPMC,没再用MIG了。所以对MIG也不是很熟悉,只是曾经用过而已。
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