XILINX DDR原语模块

dpdd · 发表于 2011-8-15 16:34:40

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小弟用ADC083000采集到的数据送入FPGA，想将数据由原来的375MHz降频到187.5MHz
小弟新手求赐教

eaglelsb · 发表于 2011-8-16 13:20:47

你可以直接隔一个取一个吧，不过从ADC过来的数据还是375M，注意下那里的时序问题。

110500623 · 发表于 2011-8-16 15:06:45

不知道楼主什么目的，是为了把adc采进来的数据分流还是2倍抽取？

owen_gfkd · 发表于 2013-5-22 20:45:27

楼主你这个东西作出来了没有呢，小弟现在重复着你的道路。求指点啊。

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