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楼主: srouyang

求用systemverilog 验证的实例

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发表于 2007-1-3 01:21:07 | 显示全部楼层


   
原帖由 srouyang 于 2006-11-1 16:39 发表
那位大虾有用systemverilog 进行验证的实例马?可否共享以下




参看附件

Verification.Cookbook.-.Advanced.Verification.Methodology.v1.3.pdf

1.36 MB, 下载次数: 94 , 下载积分: 资产 -2 信元, 下载支出 2 信元

Advanced Verification Methodology

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发表于 2007-11-10 09:07:41 | 显示全部楼层
看看System Verilog Assertion 应用指南那本书吧,刚出的,应该还挺实用的
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发表于 2008-1-30 21:35:31 | 显示全部楼层

多谢分享

我要下载
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头像被屏蔽
发表于 2008-2-29 14:27:24 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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发表于 2008-2-29 21:05:48 | 显示全部楼层
也想知道
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发表于 2008-3-9 00:54:32 | 显示全部楼层
thanks
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发表于 2008-3-9 00:59:02 | 显示全部楼层
thanks
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发表于 2008-3-9 16:54:44 | 显示全部楼层
自己试一次旧知道了
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发表于 2008-3-14 22:17:56 | 显示全部楼层
Assertion应该只能算systemverilog中的一部分吧
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发表于 2008-3-16 05:00:49 | 显示全部楼层
thanks a lot.
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