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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera的关于时序、功耗优化的培训资料
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楼主: liuliqiang

[资料] Altera的关于时序、功耗优化的培训资料

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发表于 2016-10-9 19:50:11 | 显示全部楼层
好东西 支持~
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yfp303
发表于 2017-1-18 09:28:49 | 显示全部楼层
谢谢楼主
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发表于 2017-1-18 13:27:06 | 显示全部楼层
遇到需要降低功耗的问题，下载下来看看。
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发表于 2017-3-10 11:14:59 | 显示全部楼层
谢谢1
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发表于 2017-5-16 10:46:08 | 显示全部楼层
thanks~
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QQben
发表于 2017-5-16 14:20:20 | 显示全部楼层
谢谢分享
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QQben
发表于 2017-5-16 14:24:08 | 显示全部楼层
xxfx xxfx
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QQben
发表于 2017-5-16 14:25:25 | 显示全部楼层
xxfx xxfx
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QQben
发表于 2017-5-16 14:27:24 | 显示全部楼层
xxfx xxfx
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发表于 2017-8-22 00:03:43 | 显示全部楼层
谢谢分享。。。。
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