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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 静态时序分析在数字ASIC设计中的应用

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楼主: alex_bai

静态时序分析在数字ASIC设计中的应用

发表于 2007-4-2 15:53:23 | 显示全部楼层

it maybe useful~
3q~

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发表于 2007-4-7 22:15:54 | 显示全部楼层

强烈支持啊.

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发表于 2007-9-9 17:25:05 | 显示全部楼层

怎么都不作说明呢？

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发表于 2007-10-17 22:34:48 | 显示全部楼层

ding a

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发表于 2007-10-18 20:56:42 | 显示全部楼层

有用 ding

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发表于 2007-10-18 22:51:53 | 显示全部楼层

谢谢哦,
正在学习pt,
down下来看看

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发表于 2008-2-17 18:18:48 | 显示全部楼层

ddddddddddddddddddddddd

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发表于 2008-2-20 10:39:24 | 显示全部楼层

TKS!!!!!!!!!!!!!!!!!!!!!!!!!!!

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发表于 2008-2-20 11:08:37 | 显示全部楼层

TKS!!!!!!!!!!!!!!!!!!1

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发表于 2008-2-22 15:24:34 | 显示全部楼层

没有钱了阿

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