clock group

jiazhuliang · 发表于 2011-6-14 15:00:30

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假设有1000个reg都属于clk这个时钟，人工的选择了10 个 reg，这几个reg有分布在不同的层次路径，
怎么样吧这10个reg做个分组，时钟树生成之后只要赵到这个分支的根，就可以加入适量的clkbuffer单元，
产生需要的clock skew.有人做过吗？还请指教。

hzjoshua · 发表于 2011-6-14 20:29:10

其他全部设置exlude pin，并且设置变量不fix DRC

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