请教一下这个verilogHDL编的程序错误怎么改

anychao · 发表于 2011-6-6 09:38:55

你这代码写的也太业余了吧！好好看看别人的代码再自己写，先磨刀

alexander21th · 发表于 2011-6-6 11:10:35

是不是你后面的数字要给换成9'd191呀？写成if(INDEX==9'd191)

down_load · 发表于 2011-6-6 13:27:21

你线unix2dos，然后看看有没有半角全角问题

jackertja · 发表于 2011-6-6 21:39:44

就是那个口的问题。。。
非法字符。

110500623 · 发表于 2011-6-7 08:58:46

查找下begin...end是否匹配

xiaoluo99 · 发表于 2011-6-7 14:55:41

谢谢alexander21th，就是您说的原因，我现在改正错误了，太谢谢了，多多指教

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