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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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东方龙未名
发表于 2017-6-4 20:09:43 | 显示全部楼层
先收着了，有空试试
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云游于海
发表于 2017-6-5 09:24:27 | 显示全部楼层
谢谢分享
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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jery_cn
发表于 2017-6-6 09:35:25 | 显示全部楼层
厉害，找了很久了。谢谢
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jun_dahai
发表于 2017-6-15 16:08:10 | 显示全部楼层
没有readme文件，怎么回事？？？？
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jiangmick
发表于 2017-6-15 16:57:32 | 显示全部楼层
下载看看
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staryellowzo
发表于 2017-7-7 15:51:38 | 显示全部楼层
谢谢
ok ok ok ok ok
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charliewxj
发表于 2017-8-24 12:09:41 | 显示全部楼层
好东西
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gracexue
发表于 2017-9-7 16:33:02 | 显示全部楼层
感谢！！！
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dreamore
发表于 2017-9-15 11:21:40 | 显示全部楼层
感谢分享
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shuitian
发表于 2017-9-17 19:33:05 | 显示全部楼层
感谢感谢！
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