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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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发表于 2016-10-25 16:40:34 | 显示全部楼层
多谢，顶！！！！
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发表于 2016-10-26 15:49:10 | 显示全部楼层
下来看看。谢谢！
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发表于 2016-11-17 10:32:42 | 显示全部楼层
试试看好不好用呢。
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ljjywdz
发表于 2016-12-11 20:57:15 | 显示全部楼层
thx for sharing
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wzc92
发表于 2017-1-9 18:24:43 | 显示全部楼层
太赞了，多谢楼主分享
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发表于 2017-1-10 13:18:27 | 显示全部楼层
谢谢分享，非常好的文档
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发表于 2017-2-5 19:11:34 | 显示全部楼层
perfect
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wswlr
发表于 2017-3-16 13:22:00 | 显示全部楼层
感谢感谢！！！！
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gengbao
发表于 2017-3-16 20:39:51 | 显示全部楼层
下来看看~~~
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发表于 2017-3-25 18:22:38 | 显示全部楼层
回复 1# sinva


   下过来看看！
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