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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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kinglongzh
发表于 2015-4-21 02:03:20 | 显示全部楼层
try it
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1033179387
发表于 2015-4-22 07:44:58 | 显示全部楼层
好的，谢谢
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功夫熊猫
发表于 2015-5-5 16:15:35 | 显示全部楼层
果断收藏了
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robinliuy
发表于 2015-5-21 11:35:27 | 显示全部楼层
good point.
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下雨天睡觉
发表于 2015-5-21 16:17:44 | 显示全部楼层
不错，学习了
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izhouhai
发表于 2015-6-18 09:01:40 | 显示全部楼层
很不错，感谢楼主
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ttliu
发表于 2015-6-18 09:02:36 | 显示全部楼层
谢谢分享。
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lwjsdu
发表于 2015-7-4 18:32:15 | 显示全部楼层
thank you very much
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sdustyj
发表于 2015-7-22 10:30:17 | 显示全部楼层
谢谢分享！
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daviehj
发表于 2015-7-24 10:32:27 | 显示全部楼层
好东西啊，谢谢分享，一定不能让它沉啊
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