设为首页收藏本站

eetop公众号

创芯大讲堂

创芯人才网

切换到宽版

手机号码，快捷登录

创芯云服务 : 创芯大讲堂 | 创芯人才网 | 数字IC职业培训 EETOP诚邀线上IC培训讲师!

搜帖子

EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 谢谢各位帮忙关于quartus综合时资源消耗的另一个问题 ...

发新帖

查看: 2739|回复: 0

[求助] 谢谢各位帮忙关于quartus综合时资源消耗的另一个问题

发表于 2011-3-29 16:11:15 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要登录才可以下载或查看，没有账号？注册

x

单击看大图

图片中logic utilization的报告，其中Combinational ALUT/register pairs used in final Placement的含义我已经明白了，
但途中划红线的两处的含义我就不是特别明白了，有一个还是负值啊，希望高手不吝赐教，小弟先行谢过

final, Logic, register, 图片, 资源

相关帖子

回复

发新帖

高级模式

B Color Image Link Quote Code Smilies

您需要登录后才可以回帖登录 | 注册

本版积分规则回帖后跳转到最后一页

关闭

站长推荐 /2

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号京公网安备:11010502037710 )

GMT+8, 2024-12-23 06:01 , Processed in 0.020757 second(s), 10 queries , Gzip On, Redis On.

eetop公众号

创芯大讲堂

创芯人才网

快速回复 返回顶部 返回列表