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楼主: haonan

[求助] 请教一个关于CTS时插入buffer过多的问题

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发表于 2011-2-26 01:19:24 | 显示全部楼层
提供一种思路.
buffer插入过多. 我认为多数情况下是因为skew过大引起的. 工具努力去balance 不同clock之间的skew. 只能加大insertion delay.

造成skew过大可能有几种原因.
一种是不需要同步的clock你去balance了.
一种是无法balance的去balance了: 比如片内和片外时钟.

建议理清时钟结构再去cts.
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发表于 2011-2-27 01:26:10 | 显示全部楼层
感謝大大問了我一直以來想要問的問題
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发表于 2011-2-28 15:03:05 | 显示全部楼层
学习了
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发表于 2011-2-28 17:37:57 | 显示全部楼层
我也是进来学习的,进来一直在学APR,哈哈!
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发表于 2011-3-5 19:13:48 | 显示全部楼层
需要remove 掉ideal network?
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发表于 2011-3-6 09:57:34 | 显示全部楼层
1、cts做不了。。很有可能是没有remove掉ideal network
2、楼上有人回答插入buffer过多时因为skew偏大引起的,理论上skew是越小越好,所以工具就会尽量的插入buffer来减小各个路径之间的偏差,buffer数量就多。。。lattency值也会变大。。
建议:仔细查找时钟树路径级各级buffer,检查时钟树综合文件看是否有问题。。。。

个人理解,如有问题还请指正!
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发表于 2011-3-6 12:19:16 | 显示全部楼层
详细点,我也想问问
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发表于 2011-3-10 11:35:39 | 显示全部楼层
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发表于 2011-3-10 16:20:17 | 显示全部楼层
CG应该是clockgate吧,libary是不是正确?
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发表于 2011-3-19 20:23:51 | 显示全部楼层
有些BUF在时序库里面没有延迟信息,需要设置set_dont_use,不然工具一直会调用它导致优化不过
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