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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 綜合中三态门問題
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查看: 4268|回复: 1

[求助] 綜合中三态门問題

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艾清别诺
发表于 2010-9-24 15:35:25 | 显示全部楼层 |阅读模式

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請教：在對顶层双向端口的pad綜合后网表中出現三态门（就如 tri  pad_vdd）,後端不要求出現這個tri，請問各路大俠怎麼用命令去掉？
三态门

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zh123456789
发表于 2010-9-25 19:33:20 | 显示全部楼层
set verilogout_no_tri true
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