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VHDL_to_Verilog工具

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发表于 2005-5-13 13:52:40 | 显示全部楼层 |阅读模式

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发表于 2005-5-17 17:44:19 | 显示全部楼层

VHDL_to_Verilog工具

   能够把可综合的VHDL代码转为可综合的Verilog代码吗?代码效率怎样呢?
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发表于 2005-5-23 11:06:00 | 显示全部楼层

VHDL_to_Verilog工具

怎么样啊
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发表于 2005-6-13 18:30:24 | 显示全部楼层

VHDL_to_Verilog工具

买了的说说效果啊!要不不买。说不定我有了。
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发表于 2005-6-14 10:23:59 | 显示全部楼层

VHDL_to_Verilog工具

我原来用过这种转换工具,不知道和这个是不是一样的。我觉得转换来的代码不如自己手写的规范。就是不够专业
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发表于 2005-6-24 17:06:12 | 显示全部楼层

VHDL_to_Verilog工具

对亚买的说说了
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发表于 2005-7-20 16:56:57 | 显示全部楼层

VHDL_to_Verilog工具

expensive
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发表于 2005-7-21 16:52:01 | 显示全部楼层

VHDL_to_Verilog工具

看看
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发表于 2005-7-22 12:53:31 | 显示全部楼层

VHDL_to_Verilog工具

好贵啊 !
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发表于 2005-9-30 00:04:23 | 显示全部楼层

VHDL_to_Verilog工具

个人认为,转过的明显没有自己写的好
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