关于dc中drc规则的设置

wjie8716 · 发表于 2010-9-7 19:42:30

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做dc时，如果库里已经提供了drc规则
那么set_max_capcitance
set_max_fanout
set_max_tansition
这三个命令还有必要使用么？
如果适当设置更严格的规则对后面的设计有益处么？

随风奔跑 · 发表于 2010-9-7 21:29:38

也想求解这方面的问题。。。

keykeyi · 发表于 2010-9-9 08:56:48

运行drc不是都是图形界面的么？

断桥残雪0114 · 发表于 2010-9-12 11:19:39

顺便问一下：
set_max_fanout
set_max_tansition
这俩命令是干什么用的~~~

随风奔跑 · 发表于 2010-9-13 05:47:40

应该根据那些参数设最大值吧，比如最大扇出

艾清别诺 · 发表于 2010-9-14 03:38:01

如果在工业库中设置的值不恰当或者太乐观,这时要在命令行使用这些命令来控制设计的缓冲

wxyzn · 发表于 2010-9-16 23:36:06

建议设置这些选项，可以进一步对clock path 和reset path进行限制，避免不必要的额外逻辑产生

ddale · 发表于 2010-9-17 09:33:51

可以根据项目需要重新设置这些参数。
set_max_fanout : 最大fanout,也就是一个输出最多接多少个负载（不是电容）；
set_max_transiton : 影响可以工作的最高频率，也就是上升(10%~90%)和下降(90%~10%)的时间，也叫做
slew rate。一般信号按照上升／下降各占10%的比例来计算。
如果你的设计中进行了相关约束设置，比如设置了clock，则和clock相关的电路均按照对应的约束去实现。
对于没有被约束到的信号，则会按照DRC的要求去实现。

yongfenr · 发表于 2010-9-17 11:35:15

楼上的是正解

zb8521 · 发表于 2010-9-22 01:27:57

也就是说，DC会在clock path里面添加buffer？

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