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楼主: 小小xxl

[原创] formality中遇到unmatch的问题,请高手指点下

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发表于 2010-12-3 20:36:15 | 显示全部楼层
学习一下啊
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发表于 2011-1-20 19:12:19 | 显示全部楼层
7楼说的不对啊
verification_clock_gate_hold_mode指的是clock gating cell什么时候使时钟有效,是高是低还是高低都有,这个和dc命令里面生成clock gating的命令有关了
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发表于 2011-2-24 09:50:28 | 显示全部楼层
哈哈,formality这个东西, 总是感觉有点水
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发表于 2011-2-24 14:41:28 | 显示全部楼层
哦,明白了
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发表于 2011-10-13 18:22:52 | 显示全部楼层
虚心学习
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发表于 2011-11-14 16:18:35 | 显示全部楼层
虚心学习啦。。。
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发表于 2011-11-20 16:38:23 | 显示全部楼层
学习学习
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发表于 2013-12-26 14:10:12 | 显示全部楼层
ggggggggggggggggood
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发表于 2013-12-27 22:01:05 | 显示全部楼层
虚心的学习之。
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发表于 2014-6-7 15:31:45 | 显示全部楼层
12楼果然高
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