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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 請問 IC Compiler 的問題...(高手請進)
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查看: 3209|回复: 7

[求助] 請問 IC Compiler 的問題...(高手請進)

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leesg
发表于 2010-6-20 01:09:49 | 显示全部楼层 |阅读模式

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想請教ICC的問題
原始Verilog code( .v 檔), 要先透過DC轉成 netlist (一樣是 .v 檔)
然後才能放到 ICC 再做下去嗎?

若已在DC生成netlist前, 設定好 uniquify
那麼, 在ICC的 Milkyway 時, 需要再run 一次 uniquify 嗎?

謝謝高手
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zhqi415758192
发表于 2010-6-21 09:53:26 | 显示全部楼层
这个问题不要高手，大多数人都会的
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ji5kimo
发表于 2010-6-24 14:00:30 | 显示全部楼层
假如synthesis 後的netlist 沒有去增加這類呼叫同一subdesign 的內容, 理論上就不用了.

假如有這類狀況, import 進ICC 也會有warning/error 訊息吧 ?! (maybe 需要用check design 之類檢查)
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reddamm
发表于 2010-8-17 16:50:36 | 显示全部楼层
run一下也没关系
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eagleice
发表于 2010-8-29 14:32:48 | 显示全部楼层
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eagleice
发表于 2010-8-29 14:34:23 | 显示全部楼层
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jiancongwoo
发表于 2010-8-29 15:23:07 | 显示全部楼层
"那麼, 在ICC的 Milkyway 時, 需要再run 一次 uniquify 嗎?"
这个不需要！
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xbbx8517
发表于 2010-11-5 14:12:50 | 显示全部楼层
路过！
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