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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 大家仿真是用Modelsim还是NCVerilog？
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楼主: tntdog

[原创] 大家仿真是用Modelsim还是NCVerilog？

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ringcoolh
发表于 2010-6-4 00:53:14 | 显示全部楼层
modelsim多一些
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davidwx54
发表于 2010-6-5 22:04:02 | 显示全部楼层
modelsim很好用，NC学起来麻烦些
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sagegao
发表于 2010-6-7 13:01:37 | 显示全部楼层
我们用VCS
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jacobshen
发表于 2010-6-7 13:50:26 | 显示全部楼层
喜欢用win版的NC，比modelsim快很多
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QHERO
发表于 2010-6-27 13:38:11 | 显示全部楼层
JUST A TOOL
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windl32
发表于 2010-6-27 19:20:25 | 显示全部楼层
用NC多，但其实没什么所谓吧，都只是个工具
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oceanpie
发表于 2010-6-27 22:47:22 | 显示全部楼层
Modelsim
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Sean8152
发表于 2010-7-7 21:40:36 | 显示全部楼层
不知道。。
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shxr
发表于 2010-7-8 16:18:23 | 显示全部楼层
Modelsim
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yuanshiluoji
发表于 2010-7-9 09:11:49 | 显示全部楼层
modelsim好一点吧
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