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楼主: chenghaibo

[求助] 请教合适的verilog综合工具

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winzi
发表于 2010-12-26 14:38:48 | 显示全部楼层
工具使用
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kudzus
发表于 2010-12-26 16:20:23 | 显示全部楼层
synplify也可以的
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StopMe
发表于 2010-12-26 23:17:44 | 显示全部楼层
debussy就可以的吧
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tigerwoods1986
发表于 2010-12-27 09:42:01 | 显示全部楼层
synplify
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jianchou1989
发表于 2010-12-28 19:39:40 | 显示全部楼层
不太懂  ………………
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jianchou1989
发表于 2010-12-28 23:35:39 | 显示全部楼层
haoa
#33
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zyffpga
发表于 2010-12-31 22:28:55 | 显示全部楼层
当然dc了
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jianchou1989
发表于 2011-1-1 17:57:20 | 显示全部楼层
Design Compiler
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guojunzi
发表于 2011-1-3 21:35:49 | 显示全部楼层
design  complier
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xaaa001
发表于 2011-1-4 12:25:38 | 显示全部楼层
回复 1# chenghaibo


    自己写一个简单的综合脚本，用DC综合后看看就知道了！

自己写的代码能否综合通过还是需要保证的！
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