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[求助] 大家觉得我这个LDO的specification如何?

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发表于 2010-4-30 18:30:44 | 显示全部楼层 |阅读模式

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我的设计注重在low power. 我的model是.35 um,output是1.25V。大家可以提提意见,哪一部分不够好。谢谢

  
Specification
  
  VDD (Voltage Supply)
  
  2 V
  
  IQ (Quiescent Current)
  
  929 nA
  
  ILmax (Max Load Current)
  
  100 uA
  
  Temperature Coefficient
  
  77 ppm/
  
  Line Regulation
  
  3.6 mV/V with VDD from 1.5V to 2.4V
  
  Load Regulation
  
  55 uV/ uA with IL from 0 mA to 100 mA
  
  PSRR
  
  -38 dB at 1 kHz
  
  Phase Margin
  
  90° at IL = 0 uA
  105° at IL = 100 uA
  
  Bandwidth
  
  21 kHz at IL = 100 uA
  
  Transient Response (The load current increases from 0 mA to 100 mA and decreases from 100 mA to 0 mA both in 1 ms.)
  
  50 us for Rise edges
  60 us for Fall edges
  
  Transient Spike
  
  100 mV for Rise edges
  150 mV for Fall edges
  
发表于 2010-5-1 00:40:42 | 显示全部楼层
几点疑问:1.该LDO用于单片集成还是一个模块?
          2.IQ (Quiescent Current)  929 nA 如果工艺里面没有耗尽管如何做基准电压?
          3.如此小的负载电流,用实际意义吗?
          4.PSRR好像太低了
发表于 2010-5-1 20:00:37 | 显示全部楼层
LDO中有phase margin这个参数吗,有什么意义啊
发表于 2010-6-6 22:51:57 | 显示全部楼层
发表于 2010-8-17 23:06:45 | 显示全部楼层
PSRR。哎。
发表于 2010-8-18 00:26:46 | 显示全部楼层
Thanks man !
发表于 2010-8-18 09:43:46 | 显示全部楼层
如此小的负载电流
发表于 2010-8-18 21:22:41 | 显示全部楼层
这个LDO的用途是什么?
输出驱动能力连1mA都不到,不知道你准备用在什么地方?
另外,phasemargin是在多大负载电容的情况下得出的,一般来说适用的LDO的输出会有大较大的电容负载。
发表于 2010-8-18 21:38:16 | 显示全部楼层
lz是不是写错了,负载调整率的地方又写的是100m
发表于 2010-8-19 11:26:13 | 显示全部楼层
这么小的静态电流很不错。
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