create_generated_clock

jihuijie · 发表于 2011-2-22 18:44:24

我也碰到了这样的问题不知道怎么办

jihuijie · 发表于 2011-2-22 18:52:35

DC\PT能够对付gated clock,但是不能对付non_unate gated clock.因为这样会产生不可预计的clock.我会发个东芝 ...
alex_fang2010 发表于 2010-11-29 11:43

登录/注册后可看大图

能传我一份看看嘛？

zmn · 发表于 2011-2-22 21:03:44

学习一下

zhang2046 · 发表于 2011-3-5 19:32:55

stay tune

elliot_gao · 发表于 2011-3-6 12:23:13

恩，还是有启发的

rencj1979 · 发表于 2011-4-18 09:34:43

出现这种问题是工具不能确认到底该走哪一条路径了

abc2403 · 发表于 2011-4-18 12:25:15

没关系

盗墓者 · 发表于 2011-4-18 15:07:14

学习。。。

michealwolf8 · 发表于 2011-4-18 21:08:11

应该是RTL有问题。用counter做分频是没有问题的。

haier822 · 发表于 2011-11-17 12:50:53

请问一下
create_generated_clock -name clk_cnt32[4] -source clk_usart -divide_by 32 [get_pins clk_cnt32_reg[4]/Q]命令中红色clk_cnt32_reg[4]/Q指示的位置是rtl code中定义的clk_cnt32_reg的输出端Q，还是生成的网表中的位置？
谢谢!

见到过set_dont_touch_network [get_pins MUX2/Y], 同样get_pins后面的位置MUX2/Y不清楚是rtl code中的还是网表中的？

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[求助] create_generated_clock

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