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查看: 2581|回复: 6

[资料] SYSTEMVERILOG中的跨时钟域设计

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bjgzslw
发表于 2010-1-25 16:34:55 | 显示全部楼层 |阅读模式

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Clock Domain Crossing (CDC) Design & Verification
Techniques Using SystemVerilog
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hu200298
发表于 2010-1-27 11:12:50 | 显示全部楼层
谢谢分享
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Smiley668
发表于 2010-2-25 08:27:11 | 显示全部楼层
good thanks
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roadrunner
发表于 2010-9-1 13:53:05 | 显示全部楼层
see how to do it! tks a lot!
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liujun8128
发表于 2010-9-4 15:50:27 | 显示全部楼层
谢谢楼主，正好在学习这个呢
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200728015127036
发表于 2010-9-11 16:58:28 | 显示全部楼层
谢谢啊
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hjj1123
发表于 2011-10-20 11:07:36 | 显示全部楼层
看看》。。。。。。。。。
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