请教，在Signal tap中如果要采样全局时钟（即频率最高的时钟），采样时钟怎么设置呢？

hangaofei726 · 发表于 2010-1-19 09:52:06

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请教，在Signal tap中如果要采样全局时钟（即频率最高的时钟），采样时钟频率怎么设置呢？
据我所知，在《通原》里，采样频率一般是待采样信号频率的两倍。那么对于最高的全局时钟频率，我如何采样它呢？

eeRen · 发表于 2010-1-19 10:51:15

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chienw · 发表于 2010-1-20 12:08:05

同意楼上的建议，应该没有其他方法。不明白的是，为何要采样时钟呢？

daviehj · 发表于 2010-1-20 12:18:44

没发采样，不过你可以拉到片外来，用强点的逻辑仪来看

ddale · 发表于 2010-1-20 13:46:40

用FPGA中的PLL产生4倍的时钟再采样。

YYFFLLMMNN · 发表于 2019-7-10 08:48:55

一般为了确定时钟大小，时钟通过管脚引出来，示波器观察即可。
在sinaltap中，一般没有必要采样时钟。
比如本来时钟就200MHZ，如果用一个400MHz的时钟来采，肯定时钟波形就是乱的了，总不能用800MHz的时钟来采吧。

RotaryEngine · 发表于 2019-7-10 10:30:19

你可以用PLL再倍一個2倍取樣頻率去取
但是要看你的取樣頻率為多少
我之前有用400MHz去取200MHz的波型
取是取的到波型但是整個波型是亂的而且根本無法分析

打回原形 · 发表于 2019-7-11 19:12:41

可以把时钟分配到管脚上，用示波器观察。如果时钟都好几百M了，管脚的带宽也不支持高频输出。

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