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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › verilog编写规范，设计经验

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楼主: dft2009

[转贴] verilog编写规范，设计经验

发表于 2010-3-29 23:15:36 | 显示全部楼层

多谢
学习学习

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发表于 2010-4-3 14:25:06 | 显示全部楼层

ding!ding!ding！

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发表于 2010-4-3 16:00:49 | 显示全部楼层

谢谢楼主分享！

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发表于 2010-4-10 18:33:26 | 显示全部楼层

太快了，马上就没钱了

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发表于 2010-4-12 12:38:38 | 显示全部楼层

谢谢了 1# dft2009

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发表于 2010-4-12 19:21:13 | 显示全部楼层

3Ks .LZ

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发表于 2010-4-12 19:33:32 | 显示全部楼层

good thx

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发表于 2010-4-13 14:07:06 | 显示全部楼层

谢谢 ,下下来看看

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发表于 2011-3-21 22:22:05 | 显示全部楼层

顶下，支持楼主！

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发表于 2011-3-21 23:05:10 | 显示全部楼层

dddddddddddddd

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