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[转贴] verilog编写规范,设计经验

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发表于 2010-1-6 14:16:32 | 显示全部楼层 |阅读模式

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本人最近在使用LEDA,在工具check后,出现较多的violations,这些问题主要是因为代码编写不规范所致,所以上网搜索整理了一些有价值的资料,分享给大家!

代码编写规范,是做个好工程师必须养成的习惯,利己利人!

Verilog编写规范(整理贴).pdf

154.53 KB, 下载次数: 181 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2010-1-6 14:32:40 | 显示全部楼层
thanks for sharing
发表于 2010-1-6 20:22:12 | 显示全部楼层
xialia kankan
发表于 2010-1-7 12:46:27 | 显示全部楼层
很好!
发表于 2010-1-7 16:18:35 | 显示全部楼层
这个很好,特别是对我这种初学者来说
发表于 2010-1-7 16:35:49 | 显示全部楼层
吃过不少书写不规范的亏啊 再补补
发表于 2010-1-7 17:04:28 | 显示全部楼层
好东西,拿来看看!
发表于 2010-1-7 17:04:55 | 显示全部楼层
参考下看看哈
发表于 2010-1-7 18:39:37 | 显示全部楼层
很好,谢谢了!
发表于 2010-2-8 13:04:40 | 显示全部楼层
谢谢分享,很实用
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