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楼主: gestybear

[资料] 解决初学者疑惑：VHDL、Verilog，System+verilog比较

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websterzhao
发表于 2012-7-16 09:06:27 | 显示全部楼层
比较简洁
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dayuchao
发表于 2013-7-14 10:42:15 | 显示全部楼层
感谢分享
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shingang2001
发表于 2013-12-17 18:48:52 | 显示全部楼层
太好了  謝謝您!!
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shingang2001
发表于 2013-12-17 18:49:22 | 显示全部楼层
實在是太好了 感謝
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shingang2001
发表于 2013-12-17 19:04:31 | 显示全部楼层
謝謝您
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Betray003
发表于 2013-12-18 18:58:45 | 显示全部楼层
呵呵，看看system verilog的优势
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magicxiaobopsu
发表于 2014-2-24 09:52:35 | 显示全部楼层
bucuo!
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wlgxilinx
发表于 2014-2-24 15:48:17 | 显示全部楼层
原来看到过 的
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ra3d
发表于 2014-9-4 20:47:35 | 显示全部楼层
学习ing
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xiaojunfk
发表于 2014-9-8 12:42:30 | 显示全部楼层
kankan....
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