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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VMM for SystemVerilog （夏宇闻中文版）

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楼主: saintgang

[资料] VMM for SystemVerilog （夏宇闻中文版）

发表于 2010-12-29 14:49:29 | 显示全部楼层

so much money

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发表于 2010-12-29 14:54:24 | 显示全部楼层

no money

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发表于 2010-12-29 14:56:18 | 显示全部楼层

no money

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发表于 2010-12-29 15:06:31 | 显示全部楼层

thanks!!

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发表于 2010-12-29 15:08:27 | 显示全部楼层

thanks!!

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2010-12-29 15:09:50 | 显示全部楼层

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发表于 2010-12-29 15:12:10 | 显示全部楼层

Thanks!!!!!

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发表于 2010-12-29 15:16:28 | 显示全部楼层

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发表于 2010-12-29 15:22:31 | 显示全部楼层

where is part10?

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发表于 2011-1-9 14:13:19 | 显示全部楼层

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