状态机设计的资料

linhaidu · 发表于 2009-12-14 22:25:35

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State Machine Design Techniques for Verilog and VHDL

文章不仅讲解状态机设计的基本内容，而且关注状态及设计中使用的编码方式，比如说为什么状态机使用one-hot编码等。

junshen · 发表于 2009-12-20 21:03:24

谢谢了！！！

mafan88 · 发表于 2010-2-24 23:28:08

谢谢楼主分享！！！！！！！11

fgggggggguyrf · 发表于 2010-3-16 08:44:22

ipianbe 1# linhaidu

hidedtear · 发表于 2010-3-24 20:42:26

谢谢了

hidedtear · 发表于 2010-3-24 20:45:57

没钱了

qinze666666 · 发表于 2010-5-18 22:31:47

dddddddddddddddddddddd

icreative · 发表于 2010-5-22 00:14:04

谢谢楼主~~~~~~~~~~~

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