RAZAVI书中相位裕度的问题

gibsonmpf · 发表于 2009-12-4 17:19:14

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在《模拟CMOS集成电路设计》292页的图10.13中，作者拿这个图说明相位裕度即使达到65度，也有可能产生较大的抖动，那么这个原因是什么呢？我推断是上面两个PMOS构成的电流镜的栅长太小了，引入了短沟道效应，不知道对不对。

bellona · 发表于 2009-12-4 19:12:54

应该不是，源跟随器做输出时经常会出现这种情况，在高频下输出阻抗会增大，类似于电感，因为M5的Cgs把源和栅极短路了。Razavi 6.3节讲得很清楚

seagull6160008 · 发表于 2009-12-4 19:14:39

eeeeeee

seagull6160008 · 发表于 2009-12-4 19:15:47

ddddddd

mpf19 · 发表于 2009-12-4 19:17:29

本帖最后由 mpf19 于 2009-12-4 19:19 编辑

很不错

seagull6160008 · 发表于 2009-12-4 19:21:40

大有志者事竟成

seagull6160008 · 发表于 2009-12-4 19:31:10

xssseeee

esoil · 发表于 2009-12-4 20:03:03

恩，很好

neuyongjie · 发表于 2009-12-5 00:52:13

FOUNDING......

amodaman · 发表于 2009-12-5 01:42:23

我不同意上面的回答。

拉扎维说得已经很清楚了，在大信号的情况下，偏置电流和电压处于过渡状态，和小信号状态下分析相位余量的工作点是不同的，这是一个非线性的时域过渡问题，这种情况下零点和极点并不是小信号稳态情况下的零点和极点，所以就算小信号分析时得到了65度的相位余量，还是应该从时域分析中看一看电路对大信号的响应。

如果要考虑M5的Cgs,那么座小信号分析时候早就应该考虑过了。另外电感效应在GHz以上才有效应，这里的Unity Gain Buffer怎么会到GHz呢？

别把问题想得太复杂了，把自己绕进去了，这里面本身没有什么mystery.

RAZAVI书中相位裕度的问题

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