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楼主: ip2asic

自己设计的1T8051,带jtag 功能的8051,想卖卖

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发表于 2010-2-9 22:19:20 | 显示全部楼层
dw8051有免费的,而且是验证过的,跑100M。
你的验证有多全?
指令的排列组合是无穷多的
发表于 2010-3-26 21:39:36 | 显示全部楼层
不好卖,OpenCore的,还有很多牛逼公司都有代码,CSDN上好多啊
发表于 2010-4-1 15:28:40 | 显示全部楼层
这哥们是在偷着卖公司的CODE     鉴定完毕!
发表于 2010-6-10 14:39:41 | 显示全部楼层
支持一下吧,楼主很牛,祝今后能一帆风顺!
发表于 2011-6-14 18:54:24 | 显示全部楼层
楼主,绝的的支持,1T的8051在低端还是很有市场的!本着够用就好的原则,在低端市场上用ARM MIPS,岂不是杀鸡用牛刀吗?
发表于 2011-6-15 00:32:52 | 显示全部楼层
有没有跑过随机指令测试,和模拟器进行比较结果。
发表于 2011-6-16 13:30:30 | 显示全部楼层
1.  每条指令1个clock? 如果你是支持pipeline的话, 这是不可能的。
     条件跳转指令,返回指令, 在pipeline的情况下, 不可能只有一个clock。
     即使你做了非常全整的指令预测机制, 也不可能保证一个周期完成条件跳转。
      除非你不是真正的pipeline, 那样的话, 设计能达到的运行频率一定也上不去。

2.  你的测试覆盖率太低了。 根本不能说明问题。 完整的测试不但要覆盖到条指令
     还要覆盖到指令组合。 特别是分支跳转,中断,不同字节长度指令之间的组合。
     另外, 大量C语言的测试也是比不可少的。调用、返回,堆栈的测试也是很关键。
     你的测试里程里面连基本的CALL、POP/PUSH都没包含呢。

3.  1T8051的确有很大的优化空间, 看你是想要提高效率,还是优化面积,还是降低
     功耗。 总要有自己的特点才能让别人接受。

4.  开源吧, 如果有人感兴趣, 可以帮助你设计出一个好的MCU。 现在1T 8051太多了。
发表于 2011-10-6 17:56:59 | 显示全部楼层
請問 1T 8051 是用 super pipeline 方式嗎 ??

那是否使用 posedge + negedge ?
還是 大家 synchronou design 都使用 posedge

以前聽說有些 4T  8051 是pll clock 加快方式 , 畢竟 12 T 8051 要相容到
還是使用 12T  .

對拉現在 fpga 做的 8051 可跑到多快 clock ?
发表于 2013-4-26 00:40:33 | 显示全部楼层
不知楼主卖掉没,其实开源也是一个不错的idea
发表于 2013-4-26 08:55:05 | 显示全部楼层
能跑多快?MIPS能到多少?没有指标?
主要还是免费的下载太多了。
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