Verilog HDL程序设计实例

wenpeng · 发表于 2009-10-18 14:33:56

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本帖最后由 wenpeng 于 2009-10-18 14:57 编辑

这是两本书后的verilog HDL 实例，希望对初学者有益。

xialixiong · 发表于 2009-10-18 15:03:21

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壹加壹等于壹零 · 发表于 2009-10-20 08:13:28

谢谢分享

pp_cool · 发表于 2009-10-20 14:10:34

谢谢分享

鬼才天 · 发表于 2009-10-20 14:13:56

谢谢分享啊。信元不多啦~

xiaolanbao · 发表于 2009-10-20 17:46:48

要没钱了

stefaniell3 · 发表于 2009-11-6 05:06:44

谢谢分享

lixqing · 发表于 2009-11-6 05:38:03

不错! 好书.

猛禽 · 发表于 2009-11-27 20:10:29

下了也没啥用，不是文本格式的

cheng066 · 发表于 2009-11-27 20:11:14

楼主费心了啊

xialixiong xialixiong 当前离线积分 188 头像被屏蔽	发表于 2009-10-18 15:03:21 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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