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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › vera 验证语言介绍

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楼主: yoarst

vera 验证语言介绍

发表于 2006-10-24 12:03:29 | 显示全部楼层

验证语言固然重要，但是并不是决定性问题。
关键还在思路

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发表于 2006-10-24 21:01:42 | 显示全部楼层

看来人气不旺！

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发表于 2006-11-6 22:28:52 | 显示全部楼层

回复 #1 yoarst 的帖子

顶一个看看

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发表于 2006-11-10 13:16:09 | 显示全部楼层

ding yi ge

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发表于 2006-11-10 22:42:10 | 显示全部楼层

vera is old, ntb is oldding, systemverilog is new and young.

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发表于 2007-8-26 16:40:45 | 显示全部楼层

楼主的语言介绍在哪里呢？

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发表于 2009-12-6 12:47:05 | 显示全部楼层

路过！！

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发表于 2010-1-21 13:18:15 | 显示全部楼层

看好SV

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发表于 2010-8-14 08:12:35 | 显示全部楼层

16# duke1982 xiexie

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发表于 2010-8-14 08:13:56 | 显示全部楼层

19# lnadi 谢谢你

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