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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Cadence NC-Verilog Simulator Help v8.2, Add v9.2
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楼主: bestwonbin

[资料] Cadence NC-Verilog Simulator Help v8.2, Add v9.2

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wdmzszdw
发表于 2010-1-10 10:06:28 | 显示全部楼层
jixu ding qi,ai
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brandtop
发表于 2010-1-26 17:58:23 | 显示全部楼层
hhhhhhhhhhhhhhhhhhhhhhhhhhhh
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surpass3000
发表于 2010-1-26 19:23:30 | 显示全部楼层
谢谢分享---
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gn01277787
发表于 2010-1-26 19:52:54 | 显示全部楼层
感谢楼主分享
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frankqs
发表于 2010-2-8 16:08:26 | 显示全部楼层
学习
赫赫
谢谢！
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chenghaibo
发表于 2010-2-9 18:57:48 | 显示全部楼层
Thanks a lot!
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boyceyao
发表于 2010-4-5 14:51:01 | 显示全部楼层
good one! thanks!
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boyceyao
发表于 2010-4-5 14:54:28 | 显示全部楼层
good one! thanks!
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boyceyao
发表于 2010-4-5 14:55:29 | 显示全部楼层
good one! thanks!
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boyceyao
发表于 2010-4-5 14:57:49 | 显示全部楼层
NCverilog
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