VCO的仿真中如何设置才能解决pss不收敛的问题

mc68vz328 · 发表于 2009-6-21 01:16:12

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我用spectreRF作VCO电路的仿真中经常会出现不收敛的现象，对一些参数反复进行设置也不能解决，如何设置才能较好的解决该问题。

hxzhao2008 · 发表于 2009-6-22 18:58:43

这只能是电路参数设置的问题，没特殊办法，避开收敛问题，就意味着电路不正常工作。

widlarfan · 发表于 2009-6-26 06:33:37

Setting the simulation deck needs some tricks and you can refer to the manual provided by Cadence.

mc68vz328 · 发表于 2009-6-28 17:00:55

manual中基本上没有提到有关的tricks

semico_ljj · 发表于 2009-7-8 17:06:17

??

zml1985 · 发表于 2009-8-14 20:41:36

:lol

huhuh · 发表于 2009-8-14 21:31:14

用hspice试试，有不少option可以解决收敛问题

tjjbraye · 发表于 2009-8-15 10:33:51

原帖由 huhuh 于 2009-8-14 21:31 发表

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用hspice试试，有不少option可以解决收敛问题

rampup power+gear2only+maxstep

kool · 发表于 2009-8-15 11:49:51

原帖由 mc68vz328 于 2009-6-21 01:16 发表

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我用spectreRF作VCO电路的仿真中经常会出现不收敛的现象，对一些参数反复进行设置也不能解决，如何设置才能较好的解决该问题。

我有听到过说是，减小beat frequency和增大stable time有时能解决不收敛的问题，但是我在做simulation时，但遇见不收敛的情况，采用这两种方法也解决不了。

tjjbraye · 发表于 2009-8-15 16:56:31

原帖由 kool 于 2009-8-15 11:49 发表

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我有听到过说是，减小beat frequency和增大stable time有时能解决不收敛的问题，但是我在做simulation时，但遇见不收敛的情况，采用这两种方法也解决不了。

一般先做tran，大致确定一下需要多长时间振荡波形稳定，然后把这个时间长度作为tstab值填入

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