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查看: 12397|回复: 82

三星和MT的SD卡verilog与VHDL完整模型

发表于 2009-6-17 15:42:57 | 显示全部楼层 |阅读模式

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三星和MT的SD卡verilog与VHDL完整模型，公司内部资料

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楼主| 发表于 2009-6-17 15:46:11 | 显示全部楼层

自己先顶一个

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发表于 2009-6-17 16:18:38 | 显示全部楼层

我顶，用得到

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发表于 2009-6-17 23:01:48 | 显示全部楼层

Thanks a lot !!!!!!!!!!!!!!!

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发表于 2009-6-18 08:47:58 | 显示全部楼层

這是SDR SDRAM 而不是SD card的資料

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发表于 2009-6-18 09:57:14 | 显示全部楼层

Thanks!!!

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发表于 2009-6-18 10:28:21 | 显示全部楼层

gooddffdddddd

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发表于 2009-6-18 10:34:10 | 显示全部楼层

vendor网站上都下得到

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发表于 2009-6-18 11:06:40 | 显示全部楼层

:lol谢谢楼主

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发表于 2009-6-22 10:47:44 | 显示全部楼层

hao hao hao

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