ADC性能仿真

hjx00511 · 发表于 2009-6-15 16:21:54

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我用cadence做了一个ADC。现在要仿真一下他的静态、动态性能。
如：DNL,INL,SNR, SNDR, SFDR等指标
看了论坛里面大家的讨论，一般用matlab或verilog-A
我不会matlab，也不会verilog-A，一定要去学吗？
用cadence的virtuoso analog design environment 能直接仿真吗。
有知道的兄弟，指点一下，先谢了。

fengtang2332 · 发表于 2009-6-15 21:51:32

虽然没有亲自做过，但是看别人都是用matlab或verilog-a做的。

hjx00511 · 发表于 2009-6-16 15:27:28

谢谢楼上的。
我就是想有没有简单，方便的方法，我不要求很精确的仿真。时间有限。
也看过别人就用cadence仿真。

manly · 发表于 2009-6-17 09:34:52

matlab吧，周围的人这么做的

dmzlab · 发表于 2009-6-17 12:47:35

1.用calculator把你的数字比特输出按不同权重做和，得到重建信号
2.对重建信号做dft，再做spectralPower，注意跑了多少点就做多少点的dft。最好是64，128，。。。但是cadence里跑一个tran很花时间，尤其是跑高精度的tran，所以你要在精度和仿真时间上做权衡
3.重建信号和延时的输入信号做差，你的tb上要有两个信号源，其中s1进adc，s2接电阻到地。s2是s1的延时版本，s1进adc后延时多少时间才输出，s2也同样延时多少时间
4.对差信号做sample得到每个采样点的量化误差，注意sample的起始时间是s1的延时时间
5.把4中得到的信号除以LSB，做abs，再做average，得到用LSB表示的平均量化误差。你可以用这个误差估计adc的性能，当然这个误差一定要小于0，5LSB
6.以上步骤中提到的函数在cadence里的calculator里都有，你去找找吧。不同版本的cadence对dft的定义似乎有差别，你可以试试
终了时间=起始时间+63*时钟周期，终了时间=起始时间+64*时钟周期，结果会有不同。

至于INL和DNL，还有ENOB，我还没想出来，不过估计是用锯齿波做输入，再把输出重建为阶梯波形，当然要在时序上对齐
嘻嘻，先把期末考试应付过去，暑假里再想想

hjx00511 · 发表于 2009-6-18 10:03:17

原帖由 dmzlab 于 2009-6-17 12:47 发表

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1.用calculator把你的数字比特输出按不同权重做和，得到重建信号
2.对重建信号做dft，再做spectralPower，注意跑了多少点就做多少点的dft。最好是64，128，。。。但是cadence里跑一个tran很花时间，尤其是跑高精度的 ...

太谢谢你了！
我回去试试。