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PLL论文 |
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[1998][JSSC]A simple precharged CMOS phase frequency detector.pdf
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[2000][JSSC]A low-jitter 1.9-V CMOS PLL for UltraSPARC microprocessor applications.pdf
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[2002]A fully integrated 1.5-V 5.5-GHz CMOS phase-locked loop.pdf
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[2004]Analysis of charge-pump phase-locked loops.pdf
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abbr_e3d33fda9c3c48e04ba0a718a9b694f4.pdf
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[2005][JSSC] A 6.3-9-GHz CMOS fast settling PLL for MB-OFDM UWB applications .pdf
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[2005]An analysis of charge-pump phase-locked loops.pdf
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[2006][JSSC] A Versatile 90-nm CMOS Charge-Pump PLL for SerDes Transmitter Clocking .pdf
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[2006][JSSC]A 0.5-GHz to 2.5-GHz PLL With Fully Differential Supply Regulated Tuning.pdf
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[2006]Gain-Boosting Charge Pump for Current Matching in Phase-Locked Loop.pdf
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[2006]Gain-Boosting Charge Pump for Current Matching in Phase-Locked Loop.pdf
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[2007][JSSC]A 50-GHz Phase-Locked Loop in 0.13-$mu$ m CMOS.pdf
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abbr_2d7a68e9fb72d07e0b7ee0041d7df384.pdf
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[2007]A Single-Event-Hardened Phase-Locked Loop Fabricated in 130 nm CMOS.pdf
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[2007]Implementation of New CMOS Differential Stacked Spiral Inductor for VCO Design.pdf
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[2008][JSSC]A Digital Calibration Technique for Charge Pumps in Phase-Locked Systems.pdf
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发表于 2009-5-19 21:03:57
