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查看: 6833|回复: 27

cadence creating a verilog netlist for a schematic

发表于 2009-4-29 21:21:45 | 显示全部楼层 |阅读模式

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cadence creating a verilog netlist for a schematic
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发表于 2009-5-11 12:56:41 | 显示全部楼层

支持一下。

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发表于 2010-7-16 21:53:46 | 显示全部楼层

thanks a lot!

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发表于 2010-7-16 22:24:20 | 显示全部楼层

Thanks

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发表于 2011-3-2 17:22:54 | 显示全部楼层

xieeeeeeeeeeeeeeeeeee!

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发表于 2011-3-3 21:53:12 | 显示全部楼层

xieeeeeeeee!

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发表于 2011-9-21 20:58:59 | 显示全部楼层

帮了大忙，谢谢！

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发表于 2011-10-11 15:14:09 | 显示全部楼层

谢谢楼主分享~

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发表于 2011-12-15 14:08:00 | 显示全部楼层

xieeeeeeeeeeeeeeeeeeeeee

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发表于 2012-1-11 00:08:06 | 显示全部楼层

xian ding yi xia

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