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楼主: whiran

并串转换 verilog程序

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发表于 2010-8-5 20:03:42 | 显示全部楼层
filter_out<=y_0;
                b2<=y_1;
                b1<=y_2;
                b0<=y_3;
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发表于 2010-9-28 22:43:37 | 显示全部楼层
bucuo ,henhao
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发表于 2010-12-6 16:53:43 | 显示全部楼层
看看 看看
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发表于 2010-12-9 15:18:33 | 显示全部楼层
提醒一下:并串程序很好写,真正用就不是那么一码事了:时序上一定要满足数据时钟和输出时钟的相位关系,否则肯定出问题
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发表于 2010-12-30 15:38:35 | 显示全部楼层
看看学习学习
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发表于 2011-1-1 12:11:58 | 显示全部楼层
纯粹是为了赚信元吧。。。。。这种代码都要搞个下载!
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发表于 2011-1-2 22:54:10 | 显示全部楼层
这个。。。。
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发表于 2011-1-4 12:42:48 | 显示全部楼层
没分了
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发表于 2011-3-23 23:20:32 | 显示全部楼层
回复 1# whiran


   这个 啊啊啊啊啊啊啊啊啊啊
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发表于 2011-4-18 10:15:06 | 显示全部楼层
kankan
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