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Full-chip simulation in smart-power Workshop

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发表于 2009-4-14 14:21:03 | 显示全部楼层 |阅读模式

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Full-chip simulation in smart-power IC   是 cadence Workshop  資料   ..參考下吧

Full-chip simulation in smart-power Workshop-ESSDERC06-ABaguenier.rar

547.06 KB, 下载次数: 88 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2009-4-15 18:42:56 | 显示全部楼层
:victory:
发表于 2009-4-15 19:28:05 | 显示全部楼层
谢谢分享
发表于 2009-4-25 09:07:00 | 显示全部楼层
where the attached?
发表于 2009-4-29 14:28:15 | 显示全部楼层
Thanks.
发表于 2009-9-9 10:46:57 | 显示全部楼层
if i run the simulation on computer, how much time it will cost?
发表于 2009-9-9 11:23:29 | 显示全部楼层
发表于 2010-1-11 21:40:58 | 显示全部楼层
被删,WHY?
发表于 2010-6-24 12:55:10 | 显示全部楼层
谢谢分享
发表于 2010-12-11 00:45:23 | 显示全部楼层
thanks
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