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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › USB2.0的IP核（详细verilog源码和文档）
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楼主: whil_rin

USB2.0的IP核（详细verilog源码和文档）

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发表于 2012-1-21 22:23:50 | 显示全部楼层
感谢您的分享！
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ip_ex
发表于 2012-1-26 15:13:11 | 显示全部楼层
不厚道的楼主要遭天谴的
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发表于 2012-1-29 01:44:04 | 显示全部楼层
嗯!好資料!
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发表于 2012-1-29 14:51:20 | 显示全部楼层
不错,下了,谢谢
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发表于 2012-2-17 22:31:49 | 显示全部楼层
先看看，谢谢楼主
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雨幕
发表于 2012-2-17 23:05:49 | 显示全部楼层
顶一下！！！
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keviner
发表于 2012-2-27 01:09:02 | 显示全部楼层
多谢楼主！！！！
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kanks123
发表于 2012-2-27 21:59:39 | 显示全部楼层
好东西 多谢分享啊～～～
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发表于 2012-2-28 16:59:24 | 显示全部楼层
谢谢楼主分享呀
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kanks123
发表于 2012-2-29 16:20:03 | 显示全部楼层
看起来 不错啊 多谢分享
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