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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › freescale verilog hdl code style
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楼主: wrsh1983

freescale verilog hdl code style

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eeiicc
发表于 2010-7-16 13:07:28 | 显示全部楼层
http://instruct1.cit.cornell.edu ... reescaleVerilog.pdf
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nano_dv
发表于 2010-7-18 16:39:36 | 显示全部楼层
thanks for ur sharing
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edmund.zhu
发表于 2010-7-18 21:23:15 | 显示全部楼层
感谢共享
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Gnu_qin
发表于 2010-7-25 22:33:43 | 显示全部楼层
学习一下
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logicman
发表于 2010-7-30 23:22:28 | 显示全部楼层
谢谢分享！
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junul
发表于 2010-7-31 22:52:50 | 显示全部楼层
好像不全啊
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lightship
发表于 2010-8-1 13:27:14 | 显示全部楼层
thanks for sharing
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lightship
发表于 2010-8-1 18:09:56 | 显示全部楼层
thank a lot
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polozhang
发表于 2010-8-2 09:13:22 | 显示全部楼层
好东西！帮助不少
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zhoujinyou
发表于 2011-3-9 22:10:30 | 显示全部楼层
不错的资料,谢谢
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