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blueseatears · 发表于 2009-3-31 19:46:57

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csrGen - generate verilog RTL code for processor memory maps in ASIC/FPGA designs
From Chuck Benz.
I cannt download from his website.
Can you share it?

daheiguo@gmail.com

[ 本帖最后由 blueseatears 于 2009-3-31 19:50 编辑 ]

haomine2010 · 发表于 2010-9-14 13:14:15

hi
here it is:

markhorrow · 发表于 2013-10-18 10:11:44

非常感谢提供！

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