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急 为什么要自己写乘法器代码?

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发表于 2009-3-30 14:13:00 | 显示全部楼层 |阅读模式

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最近在学FPGA,要写一些滤波器的算法,要用到乘法器,我很奇怪大家为什么都要自己写VHDL乘法器代码,为什么不用QUARTUS内部自带的LPM乘法器?
谢谢各位高手帮小弟解决这一疑惑!
发表于 2010-8-9 22:47:17 | 显示全部楼层
可能因为功耗或面积原因,需要从RTL级入手解决
发表于 2010-8-10 11:08:34 | 显示全部楼层
量身定制呗

这还用说

不然大家都用ASIC完了
发表于 2011-5-11 10:25:09 | 显示全部楼层
大部分纯属练手,当然不排除部分有特殊要求。
FPGA会调用乘法器,DC会用DW里面的
自己写的未必有多好
发表于 2011-5-11 13:29:13 | 显示全部楼层
最好是用自带的乘法器,自写的应赶不上FPGA CORE生成的效率高,
如果担心移植问题,比如ALTERA和XILINX平台的,可以写个参数型的文件,将平台与适用位宽,signed/unsigned全包含在里面,以后换平台也轻松得很。
发表于 2011-5-11 14:20:07 | 显示全部楼层
IPcore对位宽都有限制,有的时候需要拼接使用,很麻烦。还不如自己写一个省事。
发表于 2011-5-11 17:35:38 | 显示全部楼层
从可移植型以及约束目标可控性(面积最优还是速度最优)角度讲,还是用自己写的吧,调用IP的话,FPGA时序通过并不代表DC一定通过。
发表于 2011-5-22 17:58:35 | 显示全部楼层
如果在FPGA,使用自带的IP是可以的,前提是买了相关的license,否则只能自己写
如果是做ASIC,也可以用现有的IP,成本是一个要考虑的因素,另外就是性能。所以很多设计最后还是自己设计乘法器
发表于 2011-5-23 09:30:55 | 显示全部楼层
除非是极特殊的应用场合。否则,哪怕你是用门来搭建乘法器性能也未必好过IP。比IP性能好的乘法器通常是全定制的。
发表于 2011-5-23 11:44:07 | 显示全部楼层
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